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在电子系统中，常常需要应用频率合成技术来实现跳频源设计。频率合成指对一个高稳定的参考频率进行各种技术处理，以生成一系列稳定的频率输出。目前应用最广的是锁相环（ＰＬＬ）频率合成技术，它是通过改变ＰＬＬ中的分频比Ｎ来实现跳频的，但ＰＬＬ无法避免环路锁定时间缩短与频率分辨率提高及杂散减小之间的矛盾，因此很难同时满足高速跳频和细步长、低杂散的要求。直接数字频率合成（ＤＤＳ）是一种新的频率合成技术。它具有频率分辨率高、频率切换快、频率切换时相位连续等优点，因而被广泛应用于雷达跳频、通信、电子对抗等系统中。
１ DDS基本原理
ＤＤＳ的原理框图如图１所示。相位累加器在Ａ位频率控制字ＦＣＷ的控制下，以参考时钟频率ｆｃ为采样率来产生待合成信号相位的数字线性序列，然后将其高Ｐ位作为地址码，通过查询正弦表ＲＯＭ产生Ｓ位对应信号波形的数字序列Ｓ(ｎ)，再由数模转换器将其转化为阶梯模拟电压波形，最后由低通滤波器ＬＰＦ平滑为正弦波输出。
频率控制字ＦＣＷ和时钟频率ｆｃ共同决定了ＤＤＳ的输出信号频率ｆｏ 。其关系是：
输出频率：ｆ０＝ＦＣＷ ｆｃ／２Ａ
频率的分辨率为：ｆｏ＝ｆｃ／２Ａ ２ ＡＤ９８５８的特点及送数方式
ＡＤ９８５８的主要特点：
● 具有１千兆次／秒的采样速率;
● 具有高达２ＧＨｚ的输入时钟(通过２分频);
● 集成有１０位Ｄ／Ａ转换器;
● 内含３２位可编程频率寄存器；
● 带有８位并行及ＳＰＩ串行控制接口;
● 具有自动频率扫描功能;
● 内带４个频率寄存器;
● 采用３.３Ｖ低电源供电；
● 电荷泵独立供电电压可达５Ｖ；
● 集成有２ＧＨｚ混频器。
由于ＤＤＳ产生的频率是由频率控制字ＦＣＷ控制的，改变相应频率的控制字即可获得所需频率。因此ＤＤＳ的送数方法是实现ＤＤＳ跳频源的关键之一。其内部结构框图如图２所示。
ＡＤ９８５８有并行和串行两种送数方式。数据从用户传输到ＤＤＳ器件核心需要两个步骤。在写操作时，不管是用并行送数方式还是串行送数方式，用户都要首先将数据写入Ｉ／Ｏ缓冲器。只有当数据从Ｉ／Ｏ缓冲器锁入存储寄存器，ＤＤＳ的核心才接收到数据。在ＡＤ９８５８中，触发ＦＵＤ脚或者改变预编程的Ｐｒｏｆｉｌｅ都可以使Ｉ／Ｏ缓冲器中的数据进入ＤＤＳ的核心存储寄存器。
（１）并行送数模式时，系统应激活八个双向数据口（Ｄ０～Ｄ７）、六个地址输入口（ＡＤＤＲ５～ＡＤＤＲ０）、一个读口（ＲＤ）和一个写口（ＷＲ），寄存器的选择由寄存器图提供的地址决定。读写功能由ＲＤ和ＷＲ脉冲触发控制，但这两个功能不能同时起作用。读写的数据可通过Ｄ０～Ｄ７脚传输。
许多时候ＤＤＳ都要求快速跳频，而频率的快速变化则要求寄存器的频率控制字快速更新，因此，通常都要求ＤＤＳ选用并行送数。相对于ＡＤＩ公司以往的ＤＤＳ芯片而言?ＡＤ９８５８的优势在于它具有四个频率寄存器及四个相位补偿寄存器?这使得它可以方便快速的产生跳频信号以及四相码编码调制信号?而且它转换时间极短。这是因为跳频的频率控制字已经送入ＤＤＳ核心寄存器中的四组控制寄存器，频点之间的选择是依靠外部选择信号ＰＳ１和ＰＳ０来实现的。
３ 基于ＡＤ９８５８的快速跳频设计
３．１ 跳频电路
送数及四频点的切换通过单片机来完成。８９Ｃ５１单片机可在５Ｖ电压下工作，但实验证明，３．３Ｖ供电时，８９Ｃ５１单片机的工作也是完全正常的，采用单片机和ＤＤＳ芯片ＡＤ９８５８设计的跳频原理图如图３。
３．２ 软件程序设计
根据ＡＤ９８５８的时序特点，可将单片机的Ｐ１．０和Ｐ１．１分别与ＲＤ和ＷＲ相连。这样，编程时就可以对频率控制字和相位补偿字的地址列表作如下具体设置：
ＦＴＷ０＿１ ＥＱＵ ００１０１０１１Ｂ
ＦＴＷ０＿２ ＥＱＵ ００１０１１１１Ｂ
ＦＴＷ０＿３ ＥＱＵ ００１１００１１Ｂ
ＦＴＷ０＿４ ＥＱＵ ００１１０１１１Ｂ
ＰＯＷ０＿１ ＥＱＵ ００１１１０１１Ｂ
ＰＯＷ０＿２ ＥＱＵ ００１１１１１１Ｂ
最低两位分别是ＲＤ和ＷＲ，初始化时将其均置为高位。三到六位才是送数的地址。一个频点的送数程序如下：
ＭＯＶ Ｐ３, ４０Ｈ
ＭＯＶ Ｐ１, ＃ＦＴＷ０＿１
ＣＬＲ ＷＲ＿
ＳＥＴＢ ＷＲ＿
ＳＥＴＢ ＦＵＤ
ＣＬＲ ＦＵＤ
ＭＯＶ Ｐ３, ４０Ｈ
ＭＯＶ Ｐ１, ＃ＦＴＷ０＿２
ＣＬＲ ＷＲ＿
ＳＥＴＢ ＷＲ＿
ＳＥＴＢ ＦＵＤ
ＣＬＲ ＦＵＤ
ＭＯＶ Ｐ３,４０Ｈ
ＭＯＶ Ｐ１, ＃ＦＴＷ０＿３
ＣＬＲ ＷＲ＿
ＳＥＴＢ ＷＲ＿
ＳＥＴＢ ＦＵＤ
ＣＬＲ ＦＵＤ
ＭＯＶ Ｐ３, ＃４０Ｈ
ＭＯＶ Ｐ１, ＃ＦＴＷ０＿４
ＣＬＲ ＷＲ＿
ＳＥＴＢ ＷＲ＿
ＳＥＴＢ ＦＵＤ
ＣＬＲ ＦＵＤ
;
ＭＯＶ Ｐ３, ＃００Ｈ
ＭＯＶ Ｐ１, ＃ＰＯＷ０＿１
ＣＬＲ ＷＲ＿
ＳＥＴＢ ＷＲ＿
ＳＥＴＢ ＦＵＤ
ＣＬＲ ＦＵＤ
；
ＭＯＶ Ｐ３, ＃００Ｈ
ＭＯＶ Ｐ１, ＃ＰＯＷ０＿２
ＣＬＲ ＷＲ＿
ＳＥＴＢ ＷＲ＿
ＳＥＴＢ ＦＵＤ
ＣＬＲ ＦＵＤ
设计时，应先将８位频率控制字送入单片机的Ｐ３口，再将这８位的地址送入Ｐ１口。由于送８位地址的同时也将ＷＲ置为高位。因此，将ＷＲ置低就可将８位控制字和６位地址送入ＤＤＳ缓冲器。由于频率的更新只需ＦＵＤ一个上升沿，所以将ＦＵＤ置为高位就可将８位数据送入指定的频率寄存器（初始化已将ＦＵＤ置为低位），最后再将ＦＵＤ置为低位，以为后边的频率更新设置上升沿做准备。
通过一个简单的程序可将一个频点的控制字送入ＤＤＳ的存储寄存器。再通过相同的地址列表和送数方式就可将所需要的其它三个频点送入ＤＤＳ的存储寄存器。这样，通过外部选择信号ＰＳ１和ＰＳ０就可以快速在这四个频点间进行切换。
由于ＡＤ９８５８内部的频率寄存器有限，因此，在跳频的频点较多时，每次跳频都需要改变频率控制字。ＤＤＳ的实际跳频时间包括送数和内部切换时间。如果使用内部寄存器通过ＰＳ１和ＰＳ０来控制切换频率，则跳频时间只有内部切换时间，所以，这种跳频是相当快的。
４ 实验及测试结果
实验表明（该实验采用４００ＭＨｚ低相噪时钟）：ＡＤ９８５８的内部切换时间仅为纳秒级。该实验使用周期逻辑电平控制 ＰＳ１和ＰＳ０，并通过对ＰＳ１和ＰＳ０信号的选择来实现频率的切换。最后使用高频示波器来测试跳频时间。
笔者进行的第一个实验是将一个寄存器的频点ＦＣＷ设为００００００００Ｈ（０ＭＨｚ），另一个寄存器的频点ＦＣＷ设为２０００００００Ｈ（１２５ＭＨｚ）。测试结果为：从０ＭＨｚ跳频到１２５ＭＨｚ所用的时间为１７．６ｎｓ。
第二个实验是将一个寄存器的频点ＦＣＷ设为１９９９９９９９Ｈ（１００ＭＨｚ），另一寄存器的频点ＦＣＷ设为２０００００００Ｈ（１２５ＭＨｚ）。测试结果为：从１００ＭＨｚ跳频到１２５ＭＨｚ所用的时间为３３．６ｎｓ。
５ 结论
从两次测试的结果来看利用ＡＤ９８５８内部寄存器来实现快速跳频是完全可行的。由于测试过程中存在数据传输延迟，ＰＳ０和ＰＳ１控制电平的上升沿，所以测试存在一定的误差，实际跳频时间应比测试结果更短一些。
由于ＡＤ９８５８内部只有四个频率寄存器，所以跳频的点有限。在跳频点不需要很多、跳频时间要求很短时，此方法优越性十分明显。
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